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数据加密
当前位置：e-works首页 > 资料 > 基础信息化 > 数据加密
  • 资料名称：
    商业密码芯片的研究与开发
  • 资料关键字：
    高级加密标准算法 密码 FPGA Verilog HDL
  • 资料语言：
    简体中文
    运行环境：
    Win2K Win9x
  • 授权方式：
    共享资料
    资料大小：
    2.65M
  • 资料等级：
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  • 整理时间：
    2007-9-18 11:40:57
    原创作者：
    唐明 
  • 下载次数：
    2
  • 资料简介：
    本文的研究开发工作受到国家863计划项目(商业密码芯片的安全结构和技术研究)的支持。本文分析了高级加密标准算法的原理，并在此基础上针对硬件设计的特点和对速度的要求，对AES的硬件实现方法进行研究，并用硬件设计语言(Verilog HDL)描述了该算法的基本过程和结构，完成了密钥长度为128比特的AES的加了解密FPGA设计。通过计算机仿真表明，在时钟频率为25MHZ的条件下，加解密速度是3.2Gbits/s，达到预期的设计要求。
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