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PLM综合
VHDL实用程序
发布时间:2011-05-03
作者:
佚名
资料简介:
组合逻辑:
最高优先级编码器 8位相等比较器
三人表决器(三种不同的描述方式) 加法器描述
8位总线收发器:74245 (注2) 地址译码(for m68008)
多路选择器(使用select语句) LED七段译码 ....
时序逻辑:
四D触发器:74175 用状态机实现的计数器
简单的锁存器 各种功能的计数器
简单的12位寄存器 通用寄存器
带load、clr等功能的寄存器 带三态输出的8位D寄存器:74374(注2)
移位寄存器:74164
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文档大小:
45KB
星级:
下载所需E币:免费
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关键词阅读
VHDL程序
组合逻辑
数字逻辑
EDA设计
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EDA技术与应用讲义 第6章 VHDL程序设计