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综合
当前位置：e-works首页 > 资料 > 产品创新数字化(PLM) > 综合
  • 资料名称：
    Verilog HDL综合实用教程(一)
  • 资料关键字：
    Verilog HDL 寄存器 触发器 教程
  • 资料语言：
    简体中文
    运行环境：
    WinXP Win2K Win9x
  • 授权方式：
    共享资料
    资料大小：
    740KB
  • 资料星级：
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  • 上传时间：
    2008-8-22 0:00:00
    原创作者：
    J·Bhasker 
  • 下载次数：
    1
  • 资料简介：
    本书是Verilog HDL寄存器传输级综合方面的实用指南，提供了大量可综合的Verilog HDL示例，详细介绍了Verilog HDL结合所支持的各种语怯结构，井且用示例说明了如何把这些可综合的结构搭配起来对各种费件元件进行建模。本书还详细讲解了造成设计模型和结合出的间表功能不一致的常见原因，并给出了避免产生这些错误的建议。
    第1章介绍综合过程的基础知识，诸如什么是连线、触发器和状态以及如何确定对象的大小之类的内容。
  • 下载说明：
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